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基于verilog 的同步FIFO设计

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发表于 2009-4-23 18:44:27 | 显示全部楼层 |阅读模式

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基于verilog 的同步FIFO设计,包含原理结构图和源代码,测试文件。

fifo_syn.rar

18.47 KB, 下载次数: 836 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2009-6-8 09:16:26 | 显示全部楼层
好东西怎么没见人顶!!!我顶一个!!!
发表于 2009-6-22 09:45:41 | 显示全部楼层
好资料,谢谢楼主。
发表于 2009-6-22 10:58:01 | 显示全部楼层
verygood
发表于 2009-7-1 13:39:07 | 显示全部楼层
lslsllslslls
发表于 2009-7-1 13:41:30 | 显示全部楼层
简洁易用,真的挺好的,谢谢楼主~
发表于 2009-7-1 17:06:11 | 显示全部楼层
大哥,好帖子!
发表于 2009-7-1 17:08:24 | 显示全部楼层
简洁易用,真的挺好的,谢谢楼主~
发表于 2009-7-1 22:47:49 | 显示全部楼层
参考下
发表于 2009-7-6 14:47:01 | 显示全部楼层
这个速度能到多少?
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