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楼主: lygg093

基于verilog 的同步FIFO设计

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tianxiachengang
发表于 2010-7-28 22:35:26 | 显示全部楼层
下下来看看，谢啦
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evergreenwill
发表于 2010-7-28 23:19:33 | 显示全部楼层
xiexie  thanks a lot
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g280045620
发表于 2010-8-26 10:53:39 | 显示全部楼层
谢谢分享！！
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andrewv
发表于 2010-8-30 10:52:01 | 显示全部楼层
谢谢lz 学习一下
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fuckyouatall
发表于 2010-9-1 10:51:11 | 显示全部楼层
采用计数器来对读写数据个数计数，并产空满标记的设计有问题，当读写地址异常跳转时，会导致fifo功能不正确
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kuloloo
发表于 2010-9-1 11:13:06 | 显示全部楼层
谢谢，收藏了！！！
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rzk_nios
发表于 2010-9-9 19:25:48 | 显示全部楼层
顶一个！！！
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chenniao
发表于 2010-9-10 08:47:36 | 显示全部楼层
kankan
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songdj
发表于 2010-9-10 10:36:11 | 显示全部楼层
3q very much
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guxinyulong
发表于 2010-10-8 16:50:57 | 显示全部楼层
大哥，好帖子
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