在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
楼主: lehaha

FPGA RSIC CPU设计文档和源码 DDR SDRAM控制器verilog代码及中文说明文档

[复制链接]
发表于 2012-8-26 00:08:55 | 显示全部楼层
xie xie
发表于 2012-11-16 08:54:55 | 显示全部楼层
thanks a lot!
发表于 2012-12-10 18:08:49 | 显示全部楼层
回复 1# lehaha


    真心不错哟
发表于 2013-1-7 10:55:47 | 显示全部楼层
很好,很不错···
发表于 2013-3-8 11:48:27 | 显示全部楼层
bucuo
发表于 2013-3-20 21:23:18 | 显示全部楼层
好资料啊。。。
发表于 2013-3-25 14:12:21 | 显示全部楼层
下来学习学习
发表于 2013-3-25 20:54:17 | 显示全部楼层
谢谢,好资料哦
发表于 2013-4-6 09:57:30 | 显示全部楼层
好东西
写写
发表于 2013-4-7 13:58:06 | 显示全部楼层
挺实在的资料。
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-15 22:35 , Processed in 0.025240 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表