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[讨论] 对于不同工艺，derate数值一般由实际工程经验总结而来。 xingyun666666 2021-8-18 01274 xingyun666666 2021-8-18 14:49
[讨论] 同一个Design不同的FP下产生的clock spec相同吗? supermanwc 2021-8-17 41533 supermanwc 2021-8-20 10:34
[讨论] 请教，PBA两种类型——Standard & Exhaustive xingyun666666 2021-8-16 31513 凡人修仙传 2021-9-16 15:45
[讨论] 关于综合的area问题 xingyun666666 2021-8-13 01092 xingyun666666 2021-8-13 12:28
[讨论] 关于power和先进工艺std cell xingyun666666 2021-8-12 61914 莫名晴天 2021-8-17 08:43
[讨论] 关于double pattern的疑问 xingyun666666 2021-8-12 41251 jake 2021-8-13 07:39
[讨论] ATE施加的测试激励和ATPG模块产生的测试向量是同一个概念吗？ wenfangsibao 2021-8-11 62853 waywer 2023-3-23 16:59
[讨论] flip-chip xingyun666666 2021-8-10 11079 andyfan 2021-8-10 17:51
[讨论] •减少PG net的附近的congestion，对于高层电源走线没有必要设置pnet placement blockage xingyun666666 2021-8-10 31087 张馨然 2021-8-11 15:07
[讨论] block level只有一个边界（core和die的边界都是同一个） xingyun666666 2021-8-10 21200 xingyun666666 2021-8-11 15:34
[讨论] 请问，在top level时power cut、POC分别指的是什么？  ...2 xingyun666666 2021-8-10 123345 liaohero 2021-10-20 09:06
[讨论] top和block仿真 xingyun666666 2021-8-6 11014 jake 2021-8-9 00:18
[讨论] noise分析模式 xingyun666666 2021-8-5 11223 qq94043 2021-8-5 17:31
[讨论] low power xingyun666666 2021-8-5 21220 wxcwys 2021-8-5 14:03
[讨论] pr工具和signoff 工具之间的timing correlation xingyun666666 2021-8-4 71529 colindean 2024-1-4 17:15
[讨论] critical path分别抓出来优先绕线 xingyun666666 2021-8-4 0987 xingyun666666 2021-8-4 15:53
[讨论] congRepair -area xingyun666666 2021-8-3 41408 fayang 2021-9-16 15:52
[讨论] 判断出block的面积不够用，需要管top要面积 xingyun666666 2021-8-3 01023 xingyun666666 2021-8-3 16:07
[讨论] MEM主导和非主导desin异同 xingyun666666 2021-8-3 11159 supermanwc 2021-8-4 18:10
[讨论] MBIST影响ATPG覆盖率，怎么解决，bypass不起作用 attach_img IC菜鸟无敌 2021-7-30 11529 guiqix 2021-8-6 09:46
[讨论] 在PR最后阶段，插的filler(decap cell) xingyun666666 2021-7-28 31890 marxma 2021-9-19 21:38
[讨论] 数字后端的培训视频和完整的开发数据 新人帖 十月旧城 2021-7-25 31699 斯特李 2021-12-6 10:34
[讨论] PR在哪个stage加tie cell  ...2 xingyun666666 2021-7-21 142581 王晦气 2021-7-23 15:36
[讨论] 在后端额义io port的width和depth xingyun666666 2021-7-20 41271 lzqxiang 2021-7-21 17:39
[讨论] PR时有大的MEM xingyun666666 2021-7-15 41484 xingyun666666 2021-7-16 15:42
[讨论] 关于综合的问题 xingyun666666 2021-7-15 11355 挽梦夏已深 2022-7-27 09:57
[讨论] l2latch timing一般都是Multy-cycle path xingyun666666 2021-7-13 3993 ime 2021-7-14 19:02
[讨论] 关于加spare cell xingyun666666 2021-7-13 1948 lzqxiang 2021-7-13 11:29
[讨论] 组合逻辑路径长，时序比较紧的地方，工具会做一些优化增加绕线，这样的结果会加重后... xingyun666666 2021-7-8 21372 jake 2021-7-12 23:10
[讨论] 作为top owner在做partition时，当确定划分的block的形状  ...2 xingyun666666 2021-7-7 143246 xingyun666666 2024-1-5 09:37
[讨论] 开个帖子，大家任何关于CTS长tree以及CTS相关的问题 xingyun666666 2021-7-7 91397 xingyun666666 2021-7-14 16:40
[讨论] 当MEM的channel中有niose时，inn会自己把某些net变成NDR吗？ xingyun666666 2021-7-7 11201 mark1013392627 2021-7-7 20:49
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[讨论] ICG enable signal 是怎样设计的？ wenfangsibao 2021-7-1 01154 wenfangsibao 2021-7-1 16:40
[讨论] block初始的时候是42%的cell uti,place后是52%, 这个增长是正常的吗？  ...2 xingyun666666 2021-7-1 163166 jake 2021-7-7 21:52
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