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[求助] NC verilog 导出 时 总是会自动生成 -schematic的后缀？有大佬遇到过吗？ MAGA2020 2023-5-16 01653 MAGA2020 2023-5-16 11:49
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[求助] Layout VS layout 是否能保留原来cell，提示在哪个cell里 ljh065216 2023-5-15 11610 ljh065216 2023-5-15 14:06
[求助] svrf Lvs box 是否支持box整个库， ljh065216 2023-5-15 01824 ljh065216 2023-5-15 14:04
[求助] 后仿提取寄生参数卡了很久，CIW后来也不滚动了，但版图一直在转圈 attach_img sin123456 2022-6-3 42642 平常心w 2023-5-14 17:57
[原创] 保护环连接方式 attach_img ljk0596 2023-5-13 02223 ljk0596 2023-5-13 22:27
[求助] 原理图total_m和版图中的total_m不一样，跑LVS时说参数错误，这个怎么修改？ attach_img qin1900 2023-5-11 52364 qin1900 2023-5-12 14:16
悬赏 [求助] 版图密度问题 - [悬赏 50 信元资产] attach_img  ...2 新手上路哈哈哈 2023-5-8 115009 Chron97 2023-5-12 11:19
[求助] 有大佬知道哪里可以看LVS 文件代码的解析吗？ 新人帖 糖醋排骨 2023-5-12 21860 糖醋排骨 2023-5-12 10:40
[求助] virtuoso stream in 问题 新人帖  ...2 coralxie 2020-10-30 176668 麟轩 2023-5-11 16:23
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[求助] 导入GDS 后发现所有的器件都被打散了 霍比特美凌格 2016-9-12 86694 麟轩 2023-5-11 15:16
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[求助] （已解决）x86 calibre 2011 运行显示Calibre Interactive 未完全激活如何解决？ attach_img  ...2 z20102760 2013-8-31 1514307 sandglass 2023-5-11 12:58
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[求助] 后仿真之后原理图内设置的电阻宽长比不对 Eric_Lin 2023-5-11 01223 Eric_Lin 2023-5-11 10:45
[求助] 请问在virtuoso layout中如何定义新的layer？谢谢 sys0613 2017-7-24 99122 johnysmithzhang 2023-5-10 23:01
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