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求助：Hercules LVS问题 ...2 3	sunshinell 2009-9-14	2113457	smilyrong 2011-6-3 16:55
[讨论] DC/PT 漏约束，误约束的路径？	sweeting 2011-6-2	24287	sweeting 2011-6-3 16:05
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数字电路设计的一些看法	lvwei_1024 2008-7-14	84039	JUNJUN421 2011-5-31 16:54
[原创] floorplan中的标准单元 ...2	twn2000 2011-5-23	169208	damonzhao 2011-5-31 15:44
[求助] 求助：数字模块的一个输入信号在DC综合的过程中，被优化掉了。	xiaosha921 2011-5-29	34506	yueluofenghen 2011-5-31 15:40
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[讨论] 各位大侠，说说IC layout 以后的发展方向	youwl 2010-12-5	66313	paulszicc 2011-5-30 15:12
[原创] 时钟问题	心海的一滴泪 2011-5-29	111951	陈涛 2011-5-30 12:10
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[求助] 关于错误提示的问题	felron 2011-5-29	04220	felron 2011-5-29 17:02
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[求助] 请问大虾们能不能在IP上方走线	haonan 2011-5-26	53637	陈涛 2011-5-27 23:50
[求助] 提问：PR后的DRC问题？？	14052011 2011-5-25	63984	14052011 2011-5-27 23:29
[原创] 请问有没有人画过如下的IC IO 结构：外围是PAD,靠内是抗ESD保护的PMOS和NMOS ？	bamboo_gy 2011-5-12	43878	andyjackcao 2011-5-27 22:42
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[求助] 请教calibre中rule的一个问题？	B40514066 2010-12-4	23474	走直线的螃蟹 2011-5-27 18:31
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请教bottom up 综合（gate clock）	heavenbird 2009-8-12	43514	farren 2011-5-27 08:30
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[求助] 弱问：全是上升沿触发的clk，在CTS时还需要考虑下降沿的skew balance吗？	chris_li 2011-5-24	33688	zhq415758192 2011-5-26 19:33
急问:DC 综合过程中的.pvl .syn .mr文件用什么东东可以查看??	chenzhao.ee 2008-4-27	17393	y3rike 2011-5-26 18:00
[求助] encounter 好像没有基于线长的repeater 的加入	papertiger 2011-5-26	12405	paulszicc 2011-5-26 17:17
[原创] 谁能讲解下时序分析过程	yyl494577003 2011-5-26	02525	yyl494577003 2011-5-26 16:03
[求助] scan error	smilyrong 2011-5-18	33266	fxcprince 2011-5-25 21:40

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