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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 时钟问题
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查看: 10825|回复: 1

[原创] 时钟问题

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发表于 2011-5-29 22:44:58 | 显示全部楼层 |阅读模式

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现在在项目中,遇到了同相时钟的问题,比如时钟A是时钟B分频出来的,那我在时钟A频率下直接采样以时钟B运行的数据(或者在时钟B频率下直接采样以时钟A运行的数据),会不会产生亚稳态?听后端人员说应该没问题,我不敢确定.谁用过,谢谢
项目

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陈涛
发表于 2011-5-30 12:10:03 | 显示全部楼层
如果两个时钟之间不设timing exception的话，就应该没问题
但是用慢时钟采样快时钟的数据，会有数据丢失的，这个要前端考虑好。如果不想数据丢失的话，要考虑用FIFO
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