1uw以下的12bit sarADC（时钟2khz)，运放用哪种结构？

gadflybook · 发表于 2012-5-26 20:21:48

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求助啊,拜大神。碰到一个只要100sps采样率的，还把功耗定的这么点，求大神建议

半支烟 · 发表于 2012-5-27 00:44:50

求助啊,拜大神。碰到一个只要100sps采样率的，还把功耗定的这么点，求大神建议
gadflybook 发表于 2012-5-26 20:21

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可以考虑用全动态的吧，我最近试了个200KSPS的功耗只有200nW。不过速率这么低泄漏电流估计会很严重吧.你找找看，很多论文讲低速的

hsphy · 发表于 2012-5-27 10:26:12

回复 2# 半支烟

全动态offset很大，能保证12bit精度吗？
100sps采样率确实太低了，漏电流会使得电容里的charge无法长时间保持

半支烟 · 发表于 2012-5-27 11:44:35

回复半支烟

全动态offset很大，能保证12bit精度吗？
100sps采样率确实太低了，漏电流会使得电 ...
hsphy 发表于 2012-5-27 10:26

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对sar来说，offest不影响其精度的，表现为系统失调误差而已，但是会减小输入信号范围，不过对SNDR的影响很小，基本是能接受的。

zhifang · 发表于 2012-5-27 12:59:03

回复 1# gadflybook

挺容易解决的，举个简单的例子，你可以做一个1mW，100ksps的ADC，然后打开转换一次就关闭999次，这样实际工作中平均功耗就满足你的要求了。

hsphy · 发表于 2012-5-27 16:02:26

回复 4# 半支烟

SAR没做过，如果比较器offset不太重要的话，为啥我看到的12bit以上的SAR比较器都是3到4级的，这样做有什么好处？

半支烟 · 发表于 2012-5-27 18:54:56

回复半支烟

SAR没做过，如果比较器offset不太重要的话，为啥我看到的12bit以上的SAR比较器都是 ...
hsphy 发表于 2012-5-27 16:02

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以前确实一直很流行3级预防大加锁存结构，但是从最近的paper看全动态比较器占了绝大部分，主要是追求低功耗嘛，不过基本是10位以下的。我对12位以上的也没有太多了解，12位的对失调更敏感，相对来说输入范围的减小对SNDR影响也要大一些，我试着用matlab建模的话加入失调发现对SNDR的影响也还好了。我觉得可以尝试一下。

semico_ljj · 发表于 2012-5-27 20:01:51

增长知识点

Garnation · 发表于 2012-5-28 09:03:57

回复 8# semico_ljj
长知识了

gadflybook · 发表于 2012-5-28 10:17:56

回复 5# zhifang

我杂没这么想过呢？脑子木掉了。多谢

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