数字IC设计讨论(IC前端|FPGA|ASIC) 今日: 0|主题: 30089|排名: 13

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synplify的综合	wjx197733 2004-8-7	32300	bravelu 2004-8-8 12:28
边界扫描问题的疑惑 ...2	showting 2004-7-26	113387	sunny97 2004-8-7 18:01
E1中的帧头为“X0011011”,可我发现有很多相同的数据出现，请问如何提取帧头呢？	nick 2004-3-10	52956	anplayboy 2004-8-7 16:14
ACEXEP1K50QC208的全局时钟问题	showting 2004-8-6	12834	atuhappy 2004-8-6 21:43
求AMPLIFY的LICENSE	wjx197733 2004-8-6	01752	wjx197733 2004-8-6 11:23
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那个开发工具比较好(VHDL)? ...2	zxw 2004-5-13	143421	huashi911 2004-8-5 17:36
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各位高手，请教谁做过8路E1转换为1路16M数据流的fpga方案	younghot 2003-12-5	53403	guolh 2004-8-4 11:20
问：两个时钟交互使用与握手信号实现？？	showting 2004-8-3	42243	bravelu 2004-8-4 09:25
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问：pld的复用I/O脚问题	showting 2004-7-31	14289	atuhappy 2004-8-1 09:20
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问：VHDL和Vverlog可不可以混合编程	showting 2004-7-31	12184	老扁 2004-7-31 13:42
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ModelSim 5.8SE B	szjung 2004-7-29	02168	szjung 2004-7-29 11:08
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关于gclk2一问，请大家帮忙看看？	hengzhang108 2004-7-26	42292	greenpine 2004-7-28 09:17
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