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楼主: JC_09

[原创] 留下你的drc需求,我来给你写!!!

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 楼主| 发表于 2025-7-3 20:49:34 | 显示全部楼层


   
前进4 发表于 2025-7-3 15:05
求助大佬,一个层次pw,要求pw的width


PW是一层layer吗?
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 楼主| 发表于 2025-7-3 21:25:43 | 显示全部楼层


   
前进4 发表于 2025-7-3 15:05
求助大佬,一个层次pw,要求pw的width


如果一条的宽度大于0.5um,另外一条小于0.5时,是否需要触发error?
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发表于 2025-7-7 17:16:51 | 显示全部楼层

求助DRC



   
JC_09 发表于 2025-7-3 21:25
如果一条的宽度大于0.5um,另外一条小于0.5时,是否需要触发error?


不会的,这边说这样其实有错误的,写了一个上限
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 楼主| 发表于 2025-7-7 18:21:46 | 显示全部楼层


   
前进4 发表于 2025-7-7 17:16
不会的,这边说这样其实有错误的,写了一个上限


我不了解你们的实际场景,最好画下图,贴出来
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发表于 2025-7-11 09:13:16 | 显示全部楼层


   
JC_09 发表于 2025-7-7 18:21
我不了解你们的实际场景,最好画下图,贴出来


请教一下楼主,如何写一个能够抓取连到VDD的gate上的所有DIFF的面积之和,因为想要计算容值(要是能识别不同器件类型就更好了)

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 楼主| 发表于 2025-7-11 19:41:23 | 显示全部楼层


   
521009 发表于 2025-7-11 09:13
请教一下楼主,如何写一个能够抓取连到VDD的gate上的所有DIFF的面积之和,因为想要计算容值(要是能识别 ...


按我目前所了解到的,算不了面积。
电容用电路仿真一下不是更快
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发表于 2025-7-15 09:12:38 | 显示全部楼层
请问怎么判断两根net是不是同一根呢?
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发表于 2025-7-15 09:51:33 | 显示全部楼层
大佬有办法用DRC检查出,哪些地方的过孔数量少于2个么
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 楼主| 发表于 2025-7-16 08:57:04 | 显示全部楼层


   
powertoy 发表于 2025-7-15 09:51
大佬有办法用DRC检查出,哪些地方的过孔数量少于2个么


V1.single
{
@V1 >=2
(M1 AND M2) INTERACT V1 <2
}


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 楼主| 发表于 2025-7-16 08:57:59 | 显示全部楼层


   
yellti 发表于 2025-7-15 09:12
请问怎么判断两根net是不是同一根呢?


用connected来判断
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