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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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寥艺
发表于 2019-7-14 17:53:26 | 显示全部楼层
thanks a lot
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wendb
发表于 2019-7-15 08:36:03 | 显示全部楼层
look.
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发表于 2019-7-15 12:38:33 | 显示全部楼层
看看看看
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发表于 2019-7-15 17:44:49 | 显示全部楼层
study
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zhanchi
发表于 2019-7-15 18:42:08 | 显示全部楼层
谢谢

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发表于 2019-7-15 21:25:51 | 显示全部楼层
看看楼主写的教程
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发表于 2019-7-17 14:34:27 | 显示全部楼层
顶

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发表于 2019-7-17 16:39:56 | 显示全部楼层
学习一下学习一下学习一下学习一下学习一下
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发表于 2019-7-18 14:19:44 | 显示全部楼层
学习下


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发表于 2019-7-18 16:29:55 | 显示全部楼层
谢谢 非常有帮助

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