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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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mrpp
发表于 2023-12-13 19:45:57 | 显示全部楼层
看看你的
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发表于 2023-12-13 20:33:02 | 显示全部楼层
想看看
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Blochee
发表于 2023-12-15 12:29:31 | 显示全部楼层
thanks
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Roy97
发表于 2023-12-17 14:46:26 | 显示全部楼层
一起学习，一起进步
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发表于 2023-12-17 22:43:03 | 显示全部楼层
3q very much
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wwhwang
发表于 2023-12-25 21:41:12 | 显示全部楼层
看看
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skyyyy
发表于 2024-1-5 20:18:28 | 显示全部楼层
看看
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发表于 2024-1-7 20:38:07 | 显示全部楼层
谢谢分享
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wxcyyds
发表于 2024-1-9 15:41:13 | 显示全部楼层
谢谢分享！
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发表于 2024-1-17 13:57:06 | 显示全部楼层
怎么获取资料
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