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[求助] SMIC18mm模拟设计，怎样产生两相非重叠时钟？里面的与非门在哪里找？

发表于 2016-1-11 21:13:20 | 显示全部楼层 |阅读模式

200资产

如图，里面的与非门等门级电路在哪里找呢？是要自己设计吗？

捕11获.PNG

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首先，楼主，你说的应该是SMIC180nm工艺（或者叫做SMIC .18um工艺)，你来个SMIC18mm让人很无语啊。。。其次，怎样产生双向非交叠时钟？你这个图上的电路就可以！最后，与非门去哪找？当然是去提供的library里面找啊，比如看是否有做好的PCELL，如果没有的话就需要自己设计了。以上，祝好。

两相非重叠, 时钟

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发表于 2016-1-11 21:13:21 | 显示全部楼层

首先，楼主，你说的应该是SMIC180nm工艺（或者叫做SMIC .18um工艺)，你来个SMIC18mm让人很无语啊。。。其次，怎样产生双向非交叠时钟？你这个图上的电路就可以！
最后，与非门去哪找？当然是去提供的library里面找啊，比如看是否有做好的PCELL，如果没有的话就需要自己设计了。
以上，祝好。

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楼主| 发表于 2016-1-12 13:45:44 | 显示全部楼层

自己顶一下

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楼主| 发表于 2016-1-12 20:26:17 | 显示全部楼层

是SMIC .18um工艺，我看着pdk名字是smic18mm_1P6M就也这样写了~谢谢您的耐心回答，library里面没有与非门，只能自己画了，设计这种门级电路管子的是不是一般都取最小L,使用native管子呢还是用core管子好？

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发表于 2016-1-13 10:25:16 | 显示全部楼层

回复 4# liwei098109040

由于双向非交叠时钟主要考虑speed，而不是gain和noise，所以确实一般取最小的L；你说的那两种管子我没用过，不太清楚什么区别，你可以看一下model或者做一下器件仿真，看看它们的区别，我个人怀疑主要是Vth的区别，如果是的话就选Vth大的。

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楼主| 发表于 2016-1-13 14:30:52 | 显示全部楼层

回复 5# 690827881

谢谢您的耐心回复

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发表于 2016-1-14 20:20:33 | 显示全部楼层

have the same problem

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发表于 2023-6-5 15:37:18 | 显示全部楼层

Mark一下谁可以说下两相不交叠的原理？

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发表于 2023-10-12 16:39:44 | 显示全部楼层

mark

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发表于 2023-10-12 16:52:54 | 显示全部楼层

谢谢分享

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