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[求助] 关于DC多时钟约束

发表于 2015-11-24 11:03:38 | 显示全部楼层 |阅读模式

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有三个输入时钟clk2x，clk和clk_s；
其中，clk2x的频率是clk的2倍，且上升沿同步；clk_s的频率与clk相同，但是相位关系不确定。

请问各位，在三个时钟应该如何约束？

多时钟, 约束

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