skew太大

korchagin · 发表于 2015-9-9 12:00:55

回复 9# wenjian07

generate_clock跟master clock本来就是默认会balance的，只要约束没有问题，不会出现你说的情况.

wjchuan · 发表于 2015-9-9 12:51:38

回复 9# wenjian07

分步做1. 先在gen后定义2个时钟clka/clkb，先完成clka/clkb的CTS
2. 再设置成dontouch subtree，再完成master clk的CTS，如果master后面结构比较简单，可以手工完成，如果比较复杂，就交给工具吧

wenjian07 · 发表于 2015-9-9 13:02:51

回复 11# korchagin

就因为balance，所以才有问题

chrisyl · 发表于 2015-9-9 15:09:21

设置skew group呢？
将reg1,reg2设为一组，reg2后面的寄存器设为另一组。ICC skew group 对这种结构的时钟设置skew group 好像有时会设不上，可以试试。

wenjian07 · 发表于 2015-9-9 16:08:50

回复 12# wjchuan

明白，这个方法方便很多，非常感谢

wenjian07 · 发表于 2015-9-9 16:16:36

回复 14# chrisyl

你的意思我理解，但是具体方法不是很清楚，可否有相关的参考文献呢

chrisyl · 发表于 2015-9-9 17:36:15

回复 16# wenjian07

set_skew_group/commit_skew_group 去看ICC manual 吧。

wenjian07 · 发表于 2015-9-9 18:04:28

回复 17# chrisyl

好的，谢谢

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