skew太大

wenjian07 · 发表于 2015-9-7 22:02:31

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design中有两个reg，reg1和reg2，-from reg1 -to reg2有非常大的setup violation，检查timing report发现reg1的ck pin工具当作sink pin，而reg2的ck pin被工具当作implicit non-stop pin，所以两个reg cell出现非常大的local skew，如果把reg1设置为non-stop pin，reg1和reg2的clock应该是不做balance，如果把reg2设置为stop pin，clock tree又会做的比较长，而且还会引入其他violation，请问应该怎么处理比较好呢？

大龄文艺男青年 · 发表于 2015-9-8 14:06:20

你把reg2 设成stop pin不就可以了

wenjian07 · 发表于 2015-9-8 15:54:57

你把reg2 设成stop pin不就可以了
大龄文艺男青年发表于 2015-9-8 14:06

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因为有很多是non-stop的，如果设置为stop pin就会出现hold violation

大龄文艺男青年 · 发表于 2015-9-8 15:57:16

回复 3# wenjian07

你现在的问题是，因为把reg2 ck 当成了 non-stop pin ，导致tree 不齐，setup 不 meet ，那肯定先解这个问题啊，考虑hold 干嘛

korchagin · 发表于 2015-9-8 21:47:48

回复 1# wenjian07

你不会问问谁写的sdc。为什么要设为non-stop Pin?

gengweigg · 发表于 2015-9-8 21:52:00

学习一下

wjchuan · 发表于 2015-9-9 09:15:08

1. “如果把reg1设置为non-stop pin，reg1和reg2的clock应该是不做balance”，这种方法应该是不行的，如果把reg1当成non-stop pin，那么CTS或者timing 分析会穿过它，这与原来的功能一致吗？
2. “如果把reg2设置为stop pin，clock tree又会做的比较长，而且还会引入其他violation”，如果reg2是non-stop pin，那么它是有自己的用途的，把它设置成为stop pin，如果后续你还是用原来的sdc，分析timing会有很大的问题的
一般来说，non-stop pin与stop pin之前的timig检查是比较少的，要与前端确认

wenjian07 · 发表于 2015-9-9 11:01:26

回复 5# korchagin

是icc自己识别的

wenjian07 · 发表于 2015-9-9 11:06:03

本帖最后由 wenjian07 于 2015-9-9 11:11 编辑

回复 7# wjchuan

设置stop pin应该是不行的，后面会接generate clock的产生电路。
今天看了下结构，我再具体描述下我的问题，有一个master clock clock_a,它有两个generate clock，clock_g1,clock_g2，这两个generate clock之间是由timing path的，所以希望他们之间作balance,所以有些master clock clocked的regs(比如reg2...)我希望clock能穿过去，但这些由master clock clocked的regs之间也要做balance，怎么能实现clock既能穿过这些regs,又和其他stop的regs之间做balance呢？
设置float值可能是一种方法，但是如果regs太多会比较麻烦，有什么比较方便的方法吗？

不知道我的描述是否清楚

wenjian07 · 发表于 2015-9-9 11:51:36

我能想到的办法:1.设置float值2.设置-exclude_pins，然后根据skew手动调整

这两个方法都很麻烦，而且已经设置non-stop的regs很难保证,有更好的方法吗？

[求助] skew太大

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