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[求助] 带隙基准周期性抖动问题

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发表于 2013-3-2 13:11:03 | 显示全部楼层 |阅读模式

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带隙基准抖动

带隙基准抖动
这是带隙基准仿真波形。这款带隙基准用于RFID芯片中,当整流出来为周期性波动电压时,供给带隙后,带隙输出也会发生周期性抖动。在单仿带隙时,DC仿真和瞬态仿真都没有问题,可以稳定输出。但是如果瞬态加周期性电源,带隙就会出现周期性抖动。请问各位大神,这是什么情况?怎么解决?是放大器的原因吗?电源抑制比不够吗?跪求各位大神指点~~~
 楼主| 发表于 2013-3-2 14:10:21 | 显示全部楼层
怎么没人啊?自己顶一个。
发表于 2013-3-2 20:18:51 | 显示全部楼层
你的BGR在该频率的PSR很糟糕:) 请改善PSR性能。。。。如加一级RC滤波再给BGR供电就会好很多的。。。
发表于 2013-3-7 21:25:01 | 显示全部楼层
楼上正解
 楼主| 发表于 2013-3-8 20:27:08 | 显示全部楼层
回复 3# TianBian365


    那请问改善电源抑制比有什么办法吗?
发表于 2013-3-10 09:53:02 | 显示全部楼层
个人愚见,加周期性电源,应该是你的带隙的恢复时间不够,你把时间设置长一点试试,比如200us,看你的间隔也就十几us。
发表于 2013-3-15 17:33:06 | 显示全部楼层
回复 1# 钐钐


    你这是半波整流,干嘛不用全波,就没有这么大的文波了,整流输出必须加大的储能电容,你没加。还有你最好让LDO给bg供电而不是rec的输出,这是一个环,你要设计启动。
发表于 2013-4-9 16:04:11 | 显示全部楼层
PSRR的问题了。
发表于 2013-4-27 21:15:38 | 显示全部楼层
PSRR有严重的问题,这个是关键,你这个BG应该没有加运放吧,带负反馈的电路,一般不会有这么差的PSRR。可以在Vref输出加电容,降低纹波。。。
发表于 2013-7-4 19:26:53 | 显示全部楼层
学习了。。。。。。。。。。。。。。。。。。
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