求助，分频得到的时钟需要对uncertaity怎么设置？

estyzq · 发表于 2012-4-14 17:00:00

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求助，在dc的时候，如果是一个分频时钟，要如何设置uncertainty？我的master时钟设置了setup和hold分别为10%clock和5%clock；
如果分频有2、4、8分频，那么需要以及如何设置这些分频时钟的uncertainty？

zzczx · 发表于 2012-4-15 10:28:38

不设置工具算

陈涛 · 发表于 2012-4-15 13:26:19

对于初学者来讲，上面的建议足够了
如果uncertainty里面有PLL jitter产生的部分，分频后有特别的处理，以前有帖子讨论过

estyzq · 发表于 2012-4-15 23:19:51

回复 2# zzczx

那latency和transition呢？也是不设置吗？

zhq101213 · 发表于 2012-4-16 09:02:00

latency和transition综合时一般是不用设的，因为没有实际的tree

estyzq · 发表于 2012-4-16 10:35:14

回复 5# zhq101213

我在dc的时候确实是给时钟网络加上了ideal和dont touch属性但是dc在report timing的时候，还是会把这几个属性参数考虑到路径上面，
这是否说明这几个参数还是有设置的意义的？

lizhaohong520@ · 发表于 2012-5-31 16:59:52

回复 6# estyzq

帅哥你分频器的code怎么写的？全部都用计数器吗？还是用2分频驱动4分频的，这样分频下去？

tigerajs · 发表于 2012-6-2 20:40:44

从来没有约束过啊

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