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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DC综合之时序约束，公司内部解密
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楼主: graduate2010

[资料] DC综合之时序约束，公司内部解密

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Phirix
发表于 2013-7-5 13:44:58 | 显示全部楼层
擦。。。怎么是Xilinx的FPGA约束说明？？？
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GavinChang
发表于 2013-7-6 09:14:20 | 显示全部楼层
very good
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东方之子yj
发表于 2013-9-3 11:03:48 | 显示全部楼层
看看怎么样。感谢楼主。
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hjj1123
发表于 2013-9-3 15:07:20 | 显示全部楼层
看看...............
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hjj1123
发表于 2013-9-3 15:10:05 | 显示全部楼层
这个 这个是xilinx的约束
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toobad123
发表于 2013-9-4 10:49:32 | 显示全部楼层
好的啊，谢谢啦
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RaxT
发表于 2013-9-17 14:01:04 | 显示全部楼层
学习，学习一下
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aslyjr0131
发表于 2013-9-18 08:31:04 | 显示全部楼层
正在学这个...
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maochrng
发表于 2014-6-8 00:17:11 | 显示全部楼层
什么公司的呀
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牧风
发表于 2014-6-8 19:34:55 | 显示全部楼层
谢谢楼主
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