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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › DC综合之时序约束，公司内部解密
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楼主: graduate2010

[资料] DC综合之时序约束，公司内部解密

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harejavahill
发表于 2014-8-21 20:30:05 | 显示全部楼层
为什么没有人评价下附件的东西？！
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zmyxld
发表于 2014-8-21 21:49:48 | 显示全部楼层
有没有用dc topographical做低功耗的
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学晋
发表于 2014-8-23 01:03:08 | 显示全部楼层
看看看看
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326151792
发表于 2014-9-2 08:49:39 | 显示全部楼层
下下来学习下
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NinaLiu
发表于 2014-9-2 17:08:09 | 显示全部楼层
谢谢分享
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Magic_Peach
发表于 2014-9-29 10:48:39 | 显示全部楼层
收下了！
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guo_jimmy
发表于 2014-9-30 16:51:25 | 显示全部楼层
谢谢楼主
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普莱斯队长
发表于 2014-10-28 18:54:59 | 显示全部楼层
学习一下
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yiweimian
发表于 2014-10-28 21:45:22 | 显示全部楼层
好人一生平安
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peashooter
发表于 2014-11-7 16:00:39 | 显示全部楼层
look one look
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