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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL？

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bt_zhao
发表于 2022-11-28 09:46:31 | 显示全部楼层
我现在用的是systemverilog
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frederick.sande
发表于 2022-12-21 22:13:34 | 显示全部楼层
kkkkkkkkkkkk
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dmf336
发表于 2023-1-16 15:36:07 | 显示全部楼层

我觉得VERILOG好上手
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sutaotao2001
发表于 2023-2-6 08:28:16 | 显示全部楼层
a， Thanks
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wangli_peking
发表于 2023-2-21 19:40:22 | 显示全部楼层
verilog
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xiaoxiaohe
发表于 2023-2-21 20:53:36 | 显示全部楼层
主流啊
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igigigigig
发表于 2023-6-7 00:06:56 | 显示全部楼层
verilog + systemverilog
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dennisi123
发表于 2023-6-12 19:22:53 | 显示全部楼层
VHDL yyds
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发表于 2023-7-5 19:55:12 | 显示全部楼层
verilog+system_verilog，这些语言应该会向更抽象的上层发展。
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rocsman
发表于 2023-8-4 23:39:10 | 显示全部楼层
目前开始用VHDL了
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