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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2020-9-24 18:34:40 | 显示全部楼层
SystemVerilog
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发表于 2020-11-19 17:04:28 | 显示全部楼层
我想说是system Verilog
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发表于 2020-11-27 10:03:20 | 显示全部楼层
verilog
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发表于 2020-12-11 10:16:43 | 显示全部楼层
本科的时候学的是VHDL,现在用的是Verilog
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发表于 2020-12-13 15:00:30 | 显示全部楼层
VERILOG好上手
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发表于 2021-1-9 23:52:17 | 显示全部楼层
verilog开发更快更自由,适合入门
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发表于 2021-1-14 16:05:38 | 显示全部楼层
工作中verilog用的多
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发表于 2021-1-25 10:38:02 | 显示全部楼层
verilog和VHDL都用过,现在主要是用verilog,感觉VHDL更严谨,对某些特定行业更适合些
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发表于 2021-2-18 15:11:53 | 显示全部楼层
:):):)
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发表于 2021-2-20 10:01:28 | 显示全部楼层

verilog开发更快更自由,适合入门
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