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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › I2C master/slave synthesizable in verilog

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楼主: ntyntynty

I2C master/slave synthesizable in verilog

发表于 2011-10-20 14:46:38 | 显示全部楼层

哎，谢谢，最近有点头大

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发表于 2011-10-27 16:41:41 | 显示全部楼层

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发表于 2011-11-8 22:22:13 | 显示全部楼层

谢谢了。看看

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发表于 2011-11-14 17:57:55 | 显示全部楼层

我喜欢啊

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发表于 2012-2-2 14:35:24 | 显示全部楼层

不知道有没有下载说明，

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发表于 2012-2-5 15:38:50 | 显示全部楼层

Thanks!

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发表于 2012-2-6 14:44:59 | 显示全部楼层

大力支持好东西

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发表于 2012-6-1 11:17:33 | 显示全部楼层

正好需要學習這方面的知識，謝謝大大分享。

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发表于 2012-6-5 18:40:16 | 显示全部楼层

最近正好要用到，下来看看

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发表于 2012-6-5 19:19:28 | 显示全部楼层

kankan

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