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I2C master/slave synthesizable in verilog

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ntyntynty
发表于 2006-10-21 14:35:56 | 显示全部楼层 |阅读模式

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zhouweiz
发表于 2007-1-3 11:31:43 | 显示全部楼层
:) :)
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zhouweiz
发表于 2007-1-3 11:35:48 | 显示全部楼层
:$ :$
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tonyhongbin
发表于 2007-1-3 22:39:17 | 显示全部楼层
可综合的，谢谢
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lovelytwq
发表于 2007-2-1 09:26:36 | 显示全部楼层
下来看看。
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yuan_sheng
发表于 2007-2-6 15:25:11 | 显示全部楼层
不知道是否好用？
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lwc1123
发表于 2007-2-7 11:47:19 | 显示全部楼层
谁考证过是否可用么？
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risccpu
发表于 2007-2-7 13:14:36 | 显示全部楼层
有说明文档么
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dacibao
发表于 2007-2-7 22:32:50 | 显示全部楼层
看看再说，呵呵，支持一把
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dacibao
发表于 2007-2-8 11:17:02 | 显示全部楼层
好像有点点问题，rdnwr没有连接到module里面啊
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