LDO 设计一个很奇怪的问题

confiope · 发表于 2011-3-16 09:27:42

回复 confiope
PM只有几度的话，即使最后可以稳定，瞬态响应也会产生很多振铃，既然模拟的和实际的对不上 ...
zealotyao 发表于 2011-3-15 23:25

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瞬态响应没什么问题。
我一直在想模拟和真实的差别究竟在哪里？

chenxm0113 · 发表于 2011-3-16 09:48:06

回复 10# confiope

不知道“很多公司的LDO相位裕量都很小“这句依据和在。据我所知大多LDO相位裕度都会大于45度，某些极端条件下，可能会在45度附近。如果相位裕度小于45度，瞬态响应会很差，每次负载变化的时候，需要较长的时间恢复正常。这也是不合理的。

samuelyou · 发表于 2011-3-16 13:28:28

建议LZ说明下你的架构及补偿方式，有助于大家分析你遗漏的是什么

helianalog · 发表于 2011-3-16 16:27:08

回复 20# confiope

运放的第一级是指哪里？
最终pmos的gate端？

hdphoenix · 发表于 2011-3-16 18:48:58

没有图示或电路，大家各自的描述都是自己的东西，可能会产生歧义。
所以还是希望lz能发图说明一下。

xiaowanzi88 · 发表于 2011-3-23 10:14:49

将LDO的PSRR做的高，很多公司的LDO相位裕量都很小.
-----PSRR和电路结构有关，很多地方可以提高PSRR的，但不见得会牺牲PM。
如果是照抄别人的LDO结构，估计比较难了。一般LDO的PSRR在低频时达到60dB就可以。

confiope · 发表于 2011-3-23 10:44:08

将LDO的PSRR做的高，很多公司的LDO相位裕量都很小.
-----PSRR和电路结构有关，很多地方可以提高PSRR的，但 ...
xiaowanzi88 发表于 2011-3-23 10:14

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PSRR低频60dB，你这是老黄历了吧，
我们这要求70dB@1KHz。

xiaowanzi88 · 发表于 2011-3-24 15:38:39

我说的是成测60dB@1KHZ,你们按照70dB设计是对的，必须留出一定的余量。如果要求高PSRR，不是就高这10dB的。HighPSRR的LDO，通常都达到90dB@1KHz.

好速度 · 发表于 2011-3-24 17:01:06

瞬态响应有看過嗎
樓主電路架構是用怎樣的補償 miller or 靠 output capacitor的 esr
多嘗試不同esr值的電容看看吧~

confiope · 发表于 2011-3-24 17:19:24

瞬态响应有看過嗎
樓主電路架構是用怎樣的補償 miller or 靠 output capacitor的 esr
多嘗試不同esr值的 ...
好速度发表于 2011-3-24 17:01

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米勒补偿

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