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查看: 5130|回复: 26

[资料] Verilog Coding for Logic Synthesis

发表于 2010-4-8 15:29:26 | 显示全部楼层 |阅读模式

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是本英文书，里边有许多有用的可综合的代码范例，值得参考~

Verilog Coding for Logic Synthesis.pdf

1.31 MB, 下载次数: 267 , 下载积分: 资产 -2 信元, 下载支出 2 信元

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发表于 2010-4-9 20:48:39 | 显示全部楼层

thanks

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发表于 2010-4-9 22:21:35 | 显示全部楼层

顶，，

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发表于 2010-4-10 16:14:57 | 显示全部楼层

throughput

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发表于 2010-4-13 21:05:13 | 显示全部楼层

thanks

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发表于 2010-4-15 16:10:09 | 显示全部楼层

非常感谢分享

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发表于 2010-4-15 18:56:46 | 显示全部楼层

thanks

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发表于 2010-6-3 21:52:31 | 显示全部楼层

谢谢看看非常感谢

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发表于 2010-6-9 10:49:18 | 显示全部楼层

1# qq847941010
顶啊~
不错

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发表于 2010-9-24 17:30:33 | 显示全部楼层

3q 3q great

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