想学习system verilog,但不知道该怎么入手，大家能不能给些建议呢

wangfang221 · 发表于 2010-3-23 22:20:42

从vera转到sv快一年了，我就是看vcs自带的文档学的。包括vmm。什么都有，还有例子。强烈推荐。

edalearner · 发表于 2010-4-10 16:14:46

建议看ieee 1800-2005

Eric_Chu · 发表于 2010-4-11 15:53:08

正在学习中，请问楼上的VCS自带的文档是不是VCS student guide?

Eric_Chu · 发表于 2010-4-11 16:05:15

个人感觉好好看看systemverilog for verification,搞清楚基本概念

yfei2003 · 发表于 2010-4-21 13:50:00

good notes

wangjunweiair · 发表于 2010-5-13 22:11:02

学习了呵呵呵

xd_laoxie · 发表于 2010-5-14 07:51:42

共同学习，俺也不会

rr253 · 发表于 2010-5-15 08:10:52

systemverilog for verification入门

weicai13 · 发表于 2010-5-17 14:21:08

从看example入手

haibing630 · 发表于 2010-5-17 16:27:05

thank you very muh

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[求助] 想学习system verilog,但不知道该怎么入手，大家能不能给些建议呢