关于FPGA的时钟管理问题

鲁翔 · 发表于 2009-9-30 17:05:11

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最近在做一板子
要求在v5的板子上利用40mhz的输入产生05.m，1m，2m，4m，10m，20m，40m，60m的频率
用vhdl语言实现
欢迎各路高手指点

amormio124 · 发表于 2009-9-30 22:12:16

除频好做，倍频到60M怎么做不清楚

crazyfind · 发表于 2009-9-30 22:28:16

用DCM

syf1025 · 发表于 2009-10-12 00:16:09

用DCM

eaglesmiling · 发表于 2009-10-19 14:03:20

DCM FX功能，注意datasheet中的频率上下限制，如果是更低频率，直接Counter分频。

hzw650 · 发表于 2009-10-24 00:30:56

V5的片子上有PLL的吧，用那个功能很强大的。

evergaas · 发表于 2009-10-24 11:08:10

外灌得了

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