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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › USB2.0的IP核（详细verilog源码和文档）
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楼主: whil_rin

USB2.0的IP核（详细verilog源码和文档）

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发表于 2015-2-7 23:16:22 | 显示全部楼层
感谢分享
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发表于 2015-9-22 15:02:57 | 显示全部楼层
Thanks for sharing
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发表于 2015-9-22 15:06:05 | 显示全部楼层
端点顶顶顶顶顶顶顶顶顶顶
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发表于 2015-10-30 14:05:17 | 显示全部楼层
buhoudao
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zzfd97
发表于 2015-11-2 15:54:39 | 显示全部楼层
学习一下
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发表于 2015-11-3 16:10:40 | 显示全部楼层
谢谢分享
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wangzm
发表于 2018-1-4 18:52:55 | 显示全部楼层
学习一下
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Ryggeor
发表于 2018-1-4 18:59:45 | 显示全部楼层
thnx!
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cmosa
发表于 2018-1-7 20:51:56 | 显示全部楼层
内容非常感谢
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发表于 2018-1-12 15:39:38 | 显示全部楼层
kankankankankan
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