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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › USB2.0的IP核（详细verilog源码和文档）
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楼主: whil_rin

USB2.0的IP核（详细verilog源码和文档）

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发表于 2019-3-19 13:39:41 | 显示全部楼层
good resourse
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vsop
发表于 2021-3-28 11:33:22 | 显示全部楼层
谢谢分享~~~
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发表于 2021-9-29 15:59:18 | 显示全部楼层
学习下
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发表于 2021-10-21 09:19:32 | 显示全部楼层
谢谢分享~
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发表于 2021-10-21 09:20:56 | 显示全部楼层
谢谢分享
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发表于 2021-11-1 22:20:53 | 显示全部楼层
谢谢
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kinbo_z
发表于 2021-11-28 22:09:41 | 显示全部楼层
xue i xue xir
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lanfird
发表于 2021-12-3 21:45:47 | 显示全部楼层
好东西，谢谢楼主
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发表于 2022-3-9 14:51:39 | 显示全部楼层
谢谢楼主
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发表于 2022-3-9 15:09:47 | 显示全部楼层
thanks
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