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楼主: wz_cdj

Verilog Testbench设计技巧和策略

发表于 2009-9-29 18:29:46 | 显示全部楼层

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发表于 2009-9-29 18:30:48 | 显示全部楼层

不错的。。。

就是好了。。。

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发表于 2009-9-30 17:04:28 | 显示全部楼层

thanks a lot

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发表于 2009-9-30 17:14:44 | 显示全部楼层

thanks

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发表于 2009-10-3 15:37:07 | 显示全部楼层

谢谢楼主分享

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发表于 2009-10-3 19:47:41 | 显示全部楼层

到底怎么样啊？

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发表于 2009-10-6 09:26:47 | 显示全部楼层

thanks lot

碰见牛人碰见好人

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发表于 2009-10-6 09:39:09 | 显示全部楼层

赞，谢，好好学习

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发表于 2009-10-7 00:38:08 | 显示全部楼层

非常感谢楼主的资料！

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发表于 2009-10-8 21:47:38 | 显示全部楼层

thanks a lot

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