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[求助] 原理图中,电阻300k,layout画完报错,source里显示电阻150K,m为1,有没有大佬教教我 新人帖 王先生0608 2022-5-26 82294 王先生0608 2022-5-26 19:03
[求助] Calibre LVS 验证 新人帖  ...2 金刚10 2022-5-25 164846 金刚10 2022-5-26 17:00
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[求助] 版图中mim电容的连接问题!!! - [阅读权限 255] - [已解决] 北风1号 2022-1-12 8915 北风1号 2022-5-26 00:12
[求助] 40纳米smic工艺lvs问题 新人帖 Rock_Lin 2022-5-24 92370 石头遇见雪 2022-5-25 17:56
[求助] IC layout DRC 报错求助 温柔一些 2022-5-25 32030 石头遇见雪 2022-5-25 17:54
[求助] 如何将label提取处理 tfjim 2022-5-25 01665 tfjim 2022-5-25 17:31
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[原创] Cadence layout 一键添加器件编号标签SKILL脚本  ...23456..8 trumen 2014-9-17 7534873 tfjim 2022-5-25 15:21
[求助] calibre2013在virtuoso616的layout工具栏找不到 Alex杜 2018-10-16 55865 苏福人 2022-5-25 15:16
[求助] 如何写一条自定制drc,来保证两个层次是固定距离 新人帖 dypzhplv 2022-5-25 01974 dypzhplv 2022-5-25 14:50
[求助] smic013 工艺规则 中文注解 新人帖 aespaningning 2022-5-17 22117 551131519 2022-5-25 11:14
[求助] 请问一下,CUP Bonding封装,ESD做在PAD下面,ESD要怎么连到PAD 1002754471 2022-5-13 32479 1002754471 2022-5-25 10:48
[原创] VIRTUOSO导出GDS的问题,请教 新人帖 eiwen888 2022-5-23 54310 eiwen888 2022-5-24 14:27
[求助] 求一个可以报出layout中net长度大于一定值的脚本 - [已解决] hypo029 2022-4-20 52557 宝宝蓝1987119 2022-5-24 10:46
[求助] 如何用calibre生成通过逻辑运算得到的层 新人帖 东风劲吹 2022-5-23 01914 东风劲吹 2022-5-23 17:33
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[求助] *Error* eval: unbound variable - ivLVSContentsDiff大神,小弟跪谢 新人帖 Johnny2 2019-5-18 02813 Johnny2 2022-5-22 08:05
[求助] lvs  ...2 17315768922 2020-2-27 136611 terry8876 2022-5-21 18:02
[求助] 三极管并联版图怎么画 lys1371820762 2022-5-20 53834 lys1371820762 2022-5-21 11:34
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