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[原创] PLL的Power Ring问题 twn2000 2011-12-29 43250 twn2000 2011-12-30 13:30
[求助] PT分析spef文件后,关于DRC的问题 xieqq 2011-12-29 33375 xieqq 2011-12-30 09:56
[求助] 已解决——astro drc问题,请你帮忙,谢谢 attach_img haier822 2011-12-29 34920 haier822 2011-12-30 09:15
[求助] 想从FPGA转入ASIC,大侠们给点意见! neoitachi 2011-12-29 73824 zp_xd 2011-12-30 08:59
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[求助] 请教Astro Rail 读入VCD的问题 jiangweihui 2010-11-26 53073 icfbicfb 2011-12-29 22:55
[求助] spef文件格式有没有规范啊~ xieqq 2011-12-29 23849 icfbicfb 2011-12-29 22:52
[求助] 后端在CTS时遇到两个时钟域的时候,怎么办?  ...2 jason1988 2011-9-20 148217 longly0717 2011-12-29 18:51
[求助] 请教一个问题——astro  ...2 yuanzerui 2010-3-16 108309 icfbicfb 2011-12-29 16:17
[求助] 急:astro做完之后,再做PT时加不进sdf文件,求高手帮助 小小子 2011-9-9 63191 ejeffy 2011-12-29 15:05
[求助] 问一个encounter的hold检查问题 attach_img  ...2 sunsibing 2011-12-27 106727 陈涛 2011-12-29 15:04
[讨论] 请教,我在Astro中进行timing report时,max和min这两个条件怎么用反了? Langjityb 2011-11-24 63298 ejeffy 2011-12-29 14:59
求助:ASTRO的timing_report违例了,我不知道为什么  ...2 hxy687 2009-7-16 129450 ejeffy 2011-12-29 14:56
[解决] 求翻译ST&HED division abc2403 2011-12-28 32573 abc2403 2011-12-29 12:52
[求助] 问一个时序约束设置位置 attach_img sunsibing 2011-12-28 12820 陈涛 2011-12-29 12:26
[求助] [已解决]dc使用的synthetic库 estyzq 2011-12-27 32936 estyzq 2011-12-29 12:09
[原创] astro中的timing setup中parasitics问题--求解 manshy 2011-12-27 84127 manshy 2011-12-29 12:08
[求助] 求助:关于verilog网表综合 gaokl1005 2011-12-18 32705 gaokl1005 2011-12-29 09:18
[求助] 模拟pad和数字pad之间怎么连接的? staceyhoney5 2011-8-10 57968 amirjon 2011-12-29 01:19
[求助] 请大家帮帮忙,关于PAD中的信号做lvs的问题 dun21can 2011-12-26 43803 icfbicfb 2011-12-28 22:29
[讨论] 大伙来讨论下,你们后端用的sdc是怎么得来的?  ...2 zhq415758192 2011-3-16 148141 kevinht 2011-12-28 22:17
[求助] 自动布局完成后只有.v文件和工艺std的cdl网表,如何做LVS? sdwsh1 2011-12-26 48385 sdwsh1 2011-12-28 22:06
[求助] !!!!encounter中关于blackbox的问题 kuailexiari 2011-12-28 74152 damonzhao 2011-12-28 20:50
[求助] 同种工艺的不同公司的tapless library,一个有VNW和VPW,另一个却没有。 chris_li 2011-12-28 14346 icfbicfb 2011-12-28 18:37
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[讨论] DFT中所谓的加MUX,是在前端RTL代码中写好还是后端什么自动加入? 531472320 2011-11-12 95495 shycat 2011-12-27 16:33
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