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[统计] 你是用VHDL还是用Verilog HDL?

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VERILOG 是未来的趋势

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这个话题多少年之前就一直讨论
看看周围用的,大部分是verilog吧

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verilog在国内比较普遍,但是很多内核大多是用VHDL写的
verilog比较好上手,VHDL比较严谨
如果从事IC这行的这两个都必须会
尽你所能,然后顺其自然

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verilog

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小弟我也是使verilog的...

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都用……

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USE VHDL,STUDYing VE...!

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VERILOG好上手

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