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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2011-10-27 19:45:36 | 显示全部楼层
习惯用VERILOG
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发表于 2011-10-27 22:54:23 | 显示全部楼层
VERILOG 是未来的趋势
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发表于 2011-10-28 13:14:26 | 显示全部楼层
用VHDL
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发表于 2011-10-28 22:28:08 | 显示全部楼层
这个话题多少年之前就一直讨论
看看周围用的,大部分是verilog吧
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发表于 2011-10-29 10:23:46 | 显示全部楼层
verilog在国内比较普遍,但是很多内核大多是用VHDL写的
verilog比较好上手,VHDL比较严谨
如果从事IC这行的这两个都必须会
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发表于 2011-10-29 19:39:21 | 显示全部楼层
verilog
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发表于 2011-10-29 19:47:32 | 显示全部楼层
小弟我也是使verilog的...
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发表于 2011-11-1 15:52:28 | 显示全部楼层
都用……
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发表于 2011-11-2 22:22:00 | 显示全部楼层
USE VHDL,STUDYing VE...!
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发表于 2011-11-4 10:58:33 | 显示全部楼层
VERILOG好上手
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