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发表于 2015-6-2 13:20:54
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回复 7# 土豆烧牛肉WOW
expr $clock_period_dco * 0.1 --> 2ns x 0.1 = 0.2ns (clk_dco)
如果這是你所有 clk 中最小的 period, 它可能設的 max_tran 比其他小很多.
建議 clk max_tran 統一一個值, 因為你的 std cell library 應該不是有很多種不同的 max_tran.
請去看 library timing model 找到合理的中間值, 搞不好你設的值已超出 model 的 table的範圍所以一直加CK Buffer也解不掉.
另外請詳細分析你的create_clock 的位置對應所有 DFF sink 的距離是否合理, 也會造成過長的 latency, 不要一直依賴 ICC defult 的指令都不去詳細檢查. |
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