sdc和sdf有什么区别？

kahn01011 · 发表于 2012-7-4 10:07:15

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rt.，。。。。。。。。。。。

idbi · 发表于 2012-7-4 10:15:41

完全不一样
你只需要关注他们的在业界设计流程中的用途就行了，二者没有替代性：
sdc作为设计参照，可以理解为设计目标或者spec，syn，PR都要用
sdf是工具输出，与其他工具交流用的格式，所以通常是不修改的，基本上就是给VCS用。

jingangnbu · 发表于 2012-7-4 10:21:13

学习了

yiyeyo · 发表于 2012-7-4 11:23:01

一个是约束
一个是反标信息的计算而已

kahn01011 · 发表于 2012-7-4 14:07:17

多谢！！！！！！！！！！！！！

chunyubu · 发表于 2012-12-6 11:24:55

其实这两者还是有关系的。比如，抽出sdf的时候，是否需要sdc信息呢？此种sdc和sta用sdc是否一致呢？期待高手回答。

ikey · 发表于 2013-1-31 12:17:19

本帖最后由 ikey 于 2013-2-1 16:17 编辑

其实这两者还是有关系的。比如，抽出sdf的时候，是否需要sdc信息呢？此种sdc和sta用sdc是否一致呢？期待高手 ...
chunyubu 发表于 2012-12-6 11:24

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   之前有部分地方描述错误，现在更正。虽然两者是描述不同的东西，但是在STA时，qrc抽spef（RC），为了分析timing，ets需要读入sdc再吐sdf (Delay)以及报timing，所以说从flow的角度来说，两者有一定的联系，请参考下面。值得注意的是sdc的内容与约束有关，比如dont_use，dont_touch等等。

                  sdc-+
                        V
qrc->spef (RC)->ets->sdf (delay), timing

sjtusonic · 发表于 2013-1-31 13:09:45

回复 1# kahn01011

SDC:
Synopsys Design Constraints
SDF:
standard delay format

zeushuang · 发表于 2013-2-1 10:56:38

虽然字面上一个字母之差，但是内涵差别太大了。
完全不是一回事。

kahn01011 · 发表于 2013-2-1 14:38:19

回复 9# sjtusonic

tong sjtu

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