请问DC综合的乘法器是什么类型的？有必要再用verilog专门写一个乘法器吗？

wangxuede220 · 发表于 2010-10-19 15:40:54

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本帖最后由 wangxuede220 于 2010-10-20 22:19 编辑

大家好：
               请问DC对于“*”综合出来的乘法器是什么类型的？有必要再用verilog专门写一个乘法器吗？现在我的工作时钟为20m左右，数       据位数为32位的，需要乘法器在一个时钟内完成计算。
               这个综合出来的数据是多少位的呢，如果我是32×32，输出还要32位的，就是将低几位截掉，综合器可以实现吗？截掉的话，是乘法器中的加法器的操作位数也会减少吗？
               如果输出的不是32位的话，我自己设计一个输出是32位的，就是乘法器里面的加法器就会简化，是不是会会省面积呢？

lingqi0077 · 发表于 2010-10-19 19:02:13

没有必要自己写吧~用“*”的话综合出来的就是一般的组合乘法器~不过源代码是你找不到的~
20m的时钟能不能做，主要看你乘法器的位数和你用的元件库的延时情况~

wangxuede220 · 发表于 2010-10-20 08:31:36

回复 2# lingqi0077

对了，我的位数是32位的，忘了写上了！

nan123chang · 发表于 2010-10-20 12:04:45

20M没有问题。综合时指定一下乘法器的类型，比如Wallace乘法器。
// synopsys dc_script_begin
// set_implementation wall mult_u1
// synopsys dc_script_end
DW02_mult #(A_width, B_width) mult_u1(A,B,TC,RES);