state Machine Design Techniques for Verilog and VHDL

opamp1201 · 发表于 2008-9-11 14:24:27

tthanks!

shizherusi · 发表于 2008-9-11 15:24:27

收下了谢谢楼主

scallion · 发表于 2008-9-11 18:57:35

这么好的资料要多发啊

amin2008 · 发表于 2008-9-12 01:54:56

呵呵正需要呢

wxf280 · 发表于 2008-9-13 14:04:57

提示: 作者被禁止或删除内容自动屏蔽

285940684 · 发表于 2008-9-13 20:37:44

谢楼主共享资料

gahow · 发表于 2008-9-17 00:27:55

Thank you very much~~~

fkzh2651 · 发表于 2008-9-27 19:04:45

学习啊！！！！！！！！！！！！！！！！

deargod0616 · 发表于 2008-10-2 00:02:59

謝大大分享

deargod0616 · 发表于 2008-10-2 00:51:31

感謝分享

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好 ~~