求助！！数字后端ICC导出网表和gds之后，LVS一堆错

ZHZIC · 发表于 2020-11-9 11:23:33

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我先用v2lvs将导出的。v文件转换成spi格式的文件，然后将版图导入到virtuoso
第一次做LVS的时候，显示not compared
显示的错误是：Error: Different numbers of ports，下面的内容说，版图里的ports为0，网表里是15.
然后我在版图里手动添加了ports的label，再跑lvs，出现的错误更多了：

端口的数量还没有对上，对了，我的IO Pad有一个单独的电源，这个我不清楚有没有对上。
第一次做后端的这种东西，希望大佬不吝赐教，不胜感激。
马上要流片了，着急啊，心态要崩了

ZHZIC · 发表于 2020-11-9 11:26:33

上传一下完整报告

haoshiyang · 发表于 2020-11-9 11:35:01

ZHZIC 发表于 2020-11-9 11:26
上传一下完整报告

吐出来的gds是不是有问题？感觉没有吐出port的laber，确定下输出gds的脚本的正确性

ZHZIC · 发表于 2020-11-9 14:23:34

本帖最后由 ZHZIC 于 2020-11-9 14:28 编辑

set_write_stream_options -child_depth 99 -output_pin {text} -pin_name_mag 0.1
write_stream -format gds -lib_name $lib_name -cells $design_name\_final $export_path/$design_name.gds

复制代码

上面是我提取gds的命令，不知道有什么不对的地方呀

kevin_zlm · 发表于 2020-11-9 14:32:00

导入virtuoso后，需要修改lap的层次，每个工艺pin用的层次都有规定

ZHZIC · 发表于 2020-11-9 14:35:17

对了，我从gds导入到cadence的时候，直接导入到一个library库里的，是不是还需要什么map file？

ZHZIC · 发表于 2020-11-9 14:42:57

kevin_zlm 发表于 2020-11-9 14:32
导入virtuoso后，需要修改lap的层次，每个工艺pin用的层次都有规定

我用的是tsmc180的数字库tap是什么意思呀
这个不能在icc里就加吗？

haoshiyang · 发表于 2020-11-9 14:48:08

ZHZIC 发表于 2020-11-9 14:35
对了，我从gds导入到cadence的时候，直接导入到一个library库里的，是不是还需要什么map file？ ...

需要，write_stream前再设一个set_write_stream_options -map_layer gdsOutLayer.map 这个文件一般从IP Vendor提供的库文件能找到，找不到从网上下一个差不多工艺的对照tf改一改就行了

ZHZIC · 发表于 2020-11-9 14:59:07

haoshiyang 发表于 2020-11-9 14:48
需要，write_stream前再设一个set_write_stream_options -map_layer gdsOutLayer.map 这个文件一般从IP ...

谢谢大佬解答
我用了一个IO库，一个标准单元库，需要把两个map文件都加上吗？
map文件大概是下面这样子
之后往virtuoso导入的时候，需要带上相应的map文件吗

haoshiyang · 发表于 2020-11-9 15:45:37

ZHZIC 发表于 2020-11-9 14:59
谢谢大佬解答
我用了一个IO库，一个标准单元库，需要把两个map文件都加上吗？
map文件大概是下面这样子

icc导出gds的时候需要设置，gds导入virtuoso只要指定库就行了，会默认选择该库下的map文件，这个从导入gds的log里可以看到，看你这个map感觉上不是很对，你可以搜一搜ug的例子，或者上网搜一搜看看

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