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[原创] 【不忘出芯】一起学Verilog

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发表于 2019-4-29 09:47:04 | 显示全部楼层 |阅读模式

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本帖最后由 ic7x24 于 2019-5-7 21:46 编辑

【写在前面】

1. 读书和实践是学习Verilog的正确途径。
2. 逛论坛、找资料、看教程不能代替verilog的正规学习,同时可能有上网成瘾、观点误导等副作用,请谨慎使用。
3. 不要高估每天能做到的,不要低估一年能做到的。

【学习准备】

1. 搭建自己的EDA环境,最起码要有编辑器,仿真器、综合工具。
2. 使用git或者其他版本管理工具保存你的代码。建议使用github。
3. 选择一本数字电路教程,一本verilog语法书。实体书,电子版都可以。
4. 找一些朋友一起学习,相互监督。





 楼主| 发表于 2019-4-29 09:51:05 | 显示全部楼层
本帖最后由 ic7x24 于 2019-4-29 16:08 编辑

【001 进制与编码】

1. bit, byte, word, dword, qword的区别

2. 什么是原码,反码,补码,符号-数值码(sign-magnitude)。以8bit为例,给出各自表示的数值范围。

3. 十进制转换为二进制编码:
127,
(-127),
127.375,
(-127.375)

4. 设计BCD译码器,输入0~9。采用verilog描述并画出门级电路图。

5. 异步FIFO深度为18,如何设计地址格雷码?
发表于 2019-4-29 12:51:26 | 显示全部楼层
希望能够坚持写下去,加油,持续关注
发表于 2019-4-29 21:32:38 | 显示全部楼层
深度入门,看这儿:http://bbs.eetop.cn/thread-854132-1-1.html
 楼主| 发表于 2019-4-30 08:38:35 | 显示全部楼层
本帖最后由 ic7x24 于 2019-4-30 21:03 编辑

【002:门电路】

1. 画一下电路图:CMOS反相器、与非门、或非门、三态输出门、漏极开路门。

2. 解释一下Vih,Vil,Vol,Voh,Vt,Iddq

3. CMOS反相器的速度与哪些因素有关?什么是转换时间(transition time)和传播延迟(propagation delay)?

4. CMOS反相器的功耗主要包括哪几部分?分别与哪些因素相关?

5. 什么是latch-up(闩锁效应)?

6. 相同面积的cmos与非门和或非门哪个更快?
发表于 2019-4-30 16:12:10 | 显示全部楼层
非常感谢
 楼主| 发表于 2019-5-1 07:08:49 | 显示全部楼层
【003:标准单元库】

eetop论坛里面可以搜索到一些参考资料: thread-611701-1-1

1. 了解目录结构:与前端相关的比如文档(doc),仿真模型(verilog/vhdl),标准单元库(synopsys/symbols)
2. 阅读文档transition time, propagation delay等参数的定义
3. 阅读文档Power Dissipation/Calculation的描述
4. 阅读文档Delay calculation的描述
5. 提供了哪些类型的cell?
6. Verilog文件中包含了哪些信息?

 楼主| 发表于 2019-5-2 05:46:56 | 显示全部楼层

【004:组合逻辑】


1. 什么是竞争和冒险?

2. 设计一个2-4译码器。

3. 输入一个8bit数,输出其中1的个数。如果只能使用1bit全加器,最少需要几个?

4. 如果一个标准单元库只有三个cell:
    2输入mux(o = s ?a :b;),
    TIEH(输出常数1),
    TIEL(输出常数0),

    如何实现以下功能?

4.1 反相器inv

4.2 缓冲器buffer

4.3 两输入与门and2

4.4 两输入或门or2

4.5 四输入的mux  mux4

4.6 一位全加器 fa
 楼主| 发表于 2019-5-3 07:49:59 | 显示全部楼层
【005:时序电路】

1. dff和latch有什么区别。

2. 什么是同步电路和异步电路。

3. 什么是setup time和 hold time。

4. 设计一个101序列检测器。画出状态转移图,写verilog,并仿真测试。
 楼主| 发表于 2019-5-4 09:34:22 | 显示全部楼层
【006:边沿检测】

1. 复习verilog语法
- reg和wire的区别
- 阻塞赋值与非阻塞赋值的区别
- parameter与define的区别
- task与function的区别

2. 用verilog实现边沿检测电路:上升沿,下降沿,双沿(上升或下降沿)。

3. 记录一下第2题中用到的工具,包括工具版本,操作步骤或命令选项,遇到的错误,提示信息等。
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