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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 使用 Makefile+VCS+Verdi 做个简单的 Test Bench
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楼主: yoof2000

[原创] 使用 Makefile+VCS+Verdi 做个简单的 Test Bench

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发表于 2020-5-12 08:46:33 | 显示全部楼层
感谢分享
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发表于 2020-5-12 21:38:59 | 显示全部楼层
谢谢楼主
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发表于 2020-5-13 04:00:30 | 显示全部楼层
xie xie fen xiang
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发表于 2020-5-13 18:31:34 | 显示全部楼层
看看怎么写
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chier72
发表于 2020-5-13 21:01:38 | 显示全部楼层

thanks
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发表于 2020-5-14 21:03:55 | 显示全部楼层
楼主，大大的好人啊！！！！
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发表于 2020-5-15 19:34:10 | 显示全部楼层

谢谢分享！
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发表于 2020-5-16 13:05:25 | 显示全部楼层
学习学习，真是头疼，怎么安装就弄死人
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YJFEI
发表于 2020-5-16 20:10:41 | 显示全部楼层
学习一下脚本
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发表于 2020-5-21 22:44:46 | 显示全部楼层
感谢楼主分享
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