Verilog数字VLSI设计教程 PDF+verilog源码

megaic · 发表于 2016-4-22 21:58:31

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本帖最后由 megaic 于 2016-4-23 13:49 编辑

第0章概述
第1章 Verilog入门
第2章 Verilog基础知识1
第3章 Verilog基础知识2
第4章锁相环和串行/解串器入门
第5章存储与数组
第6章计数器
第7章强度和竞争
第8章状态机和FIFO
第9章事件
第10章内建器件
第11章顺序控制和并发
第12章层次和generate
第13章函数、任务和串并转换
第14章 UDP和开关级模型
第15章参数和层次
第16章配置和时序
第17章时序检查和断言
第18章解串器和升级PLL
第19章升级解串器
第20章完成串行/解串器
第21章可测性设计和全双工串行/解串器
第22章 SDF
第23章 Verilog语言总结
第24章深亚微米的问题及其验证

zys99 · 发表于 2016-4-23 07:42:35

不错的材料！

apteye · 发表于 2016-4-23 14:24:38

bucuode

牧2008 · 发表于 2016-4-23 14:43:10

谢谢分享

QQben · 发表于 2016-4-23 14:59:10

谢谢分享

嘎子 · 发表于 2016-4-23 16:15:40

楼主辛苦了

megaic · 发表于 2016-4-25 08:09:42

我顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶

megaic · 发表于 2016-4-26 10:46:15

回复 1# megaic

我顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶

菜鸟要飞 · 发表于 2016-4-26 11:11:12

楼主辛苦了

megaic · 发表于 2016-4-29 13:28:33

我地地道道的点点滴滴顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶顶弟弟

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