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[求助] 一个简单的问题,求大神帮忙

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发表于 2015-8-10 09:35:32 | 显示全部楼层 |阅读模式

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always @ (*)begin     if(!resetb)

end

这样写可以不,对应的电路结构是什么样的?
发表于 2015-8-11 08:40:42 | 显示全部楼层
always内部没有内容吗,可以看一下RTL图,就知道什么结构了。
发表于 2015-8-11 09:04:03 | 显示全部楼层
个人觉得也能实现,但是resetb不能当做复位来理解,因为组合逻辑没有复位这一说吧
发表于 2015-8-12 00:14:23 | 显示全部楼层
always里没有其他代码的话,好像综合后就被优化了。如果里面有代码,那么resetb就是选择器的使能。
发表于 2015-8-13 18:17:54 | 显示全部楼层
verilog 2001的写法,没啥问题。组合逻辑,后面所有的输入信号都可以作为触发条件。
过去写代码的时候,没有这个*,必须将所有的敏感信号列上,容易遗漏,出了问题一般还不容易查到。
发表于 2015-8-20 09:46:35 | 显示全部楼层
没有赋值语句
 楼主| 发表于 2016-3-11 10:15:56 | 显示全部楼层
谢谢大家
发表于 2016-3-11 13:53:57 | 显示全部楼层
这样写没问题,如果if 下面真的什么都没有会被综合掉的。
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