哪位大侠有用Verilog写的FIR滤波器的实例啊？

bijienanjing · 发表于 2007-5-2 17:12:23

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小弟先谢谢了：）

wice3 · 发表于 2007-5-3 18:25:22

这个是偶机器里的东西，记不得从哪里来的，希望能对设计fir的朋友们有些帮助。

内容简介：

串并FIR滤波器设计

并行FIR滤波器具有速度快、容易设计的特点，但是要占用大量的资源。在多阶数的亚高频系统设计中，使用并行结构并不合算，但亚高频系统需要较高的处理速度，而串行架构往往达不到要求，因此，结合串并这两种设计方法的长处，在使用较少的硬件资源的同时实现了较高的处理速度，这里说明一种65阶八路并行、支路串行FIR滤波器的设计（实际使用了1个乘法器，8个乘累加器，一个累加.......................

附件包含：doc设计说明文档一个，verilog源程序和testbench各一个。

补充说明：该设计调用了altera的乘法器ip核

bijienanjing · 发表于 2007-5-19 20:58:27

太感谢了：）

ZhouF · 发表于 2007-5-28 23:45:23

有没有大虾介绍下FIR滤波器的优缺点以及应用场合啊

jitongw · 发表于 2007-5-29 10:14:24

这种问题，网上 google 一下儿就好了。

原帖由 ZhouF 于 2007-5-28 23:45 发表
有没有大虾介绍下FIR滤波器的优缺点以及应用场合啊

jitongw · 发表于 2007-5-29 10:17:16

Matlab2007a 中的： HDL CODER　功能，可以自动生成　ＶＨＤＬ　　和　ＶＥＲＩＬＯＧ　程序。

原帖由 bijienanjing 于 2007-5-2 17:12 发表
小弟先谢谢了：）

happybay008 · 发表于 2007-8-7 15:34:18

xiexie

biohazard4 · 发表于 2007-8-8 10:35:25

xuexixuexi

fanhaiqiu · 发表于 2007-8-9 15:07:29

很好的资料！！！

nd9525 · 发表于 2007-10-24 21:03:00

下来看看，不过好像没钱下了。。。

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