请教高手Clock Skew问题

juediaixiaobao · 发表于 2015-4-10 15:11:58

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SDC中设了两个Clock之间的False Path，但CTS做完还会Balance，Clock skew摆不平，请教如何设置不让CTS去balance,非常感谢。

icfbicfb · 发表于 2015-4-10 15:52:28

你用了-balance_inter_clock_delay吧，

再说了，如果之间是false path，还在乎skew干啥

cts的时候不看timing的，工具只是做tree而已，

juediaixiaobao · 发表于 2015-4-10 16:29:56

没有用就是默认设置，就是Blance了两条不用Balance的clock产生了skew,就是想问如何能让它不balance,设置了exclude pin但不起作用

icfbicfb · 发表于 2015-4-11 08:25:09

是icc还是edi， cts具体命令是啥，

juediaixiaobao · 发表于 2015-4-12 12:49:52

edi,就是生成SPEC文件

Timme · 发表于 2015-4-12 13:52:58

你要想办法让这两个时钟不看到相同的Leaf Pin，比如同一个寄存器的CK不要同时属于这两个时钟树。你的exclude pin应该是没设对地方，没有完全“打断”它们交汇的路径。

举个例子：
CLK1有以下Leaf：RegCommon/CK、RegA/CK、RegB/CK、RegC/CK...
CLK2有以下Leaf：RegCommon/CK、Reg1/CK、Reg2/CK、Reg3/CK...
由于RegCommon的存在，在CLK1中RegA/B/C要跟RegCommon平衡，CLK2中Reg1/2/3也要跟RegCommon平衡，结果就是CLK1和CLK2所有的Leaf都被平衡了。

SDC里的false path在createClockTreeSpec的时候是不会考虑的。SDC只需要考虑逻辑关系，而CTS Spec只考虑物理连接关系。

icfbicfb · 发表于 2015-4-12 20:51:13

Group语句看看，是不是2个clock写在同一个group里面，去掉即可

jiazhang · 发表于 2015-5-9 15:36:01

回复 6# Timme

那请问下，对

CLK1有以下Leaf：RegCommon/CK、RegA/CK、RegB/CK、RegC/CK...
CLK2有以下Leaf：RegCommon/CK、Reg1/CK、Reg2/CK、Reg3/CK...

这种情况，该如何设置exclude pin 才对呢？

Timme · 发表于 2015-5-9 18:40:07

回复 Timme

那请问下，对

CLK1有以下Leaf：RegCommon/CK、RegA/CK、RegB/CK、RegC/CK...
CLK2有以 ...
jiazhang 发表于 2015-5-9 15:36

登录/注册后可看大图

把{RegCommon}、｛Reg A/B/C｝、{Reg 1/2/3}这三组寄存器中最不重要的那一组归到一个LeafPinGroup

具体的寄存器可以用all_fanouts抓出来

jiazhang · 发表于 2015-5-9 19:42:15

回复 9# Timme

您好，由于是新手！
(1) 能否告知下如何做呢，用什么命令将 {Reg1/2/3} 归到leafpingroup呢？

(2) 比如我将 Reg1/2/3 归到leafpingroup了，那regcommon还是存在你之前说的那个问题吧？

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