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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 关于AHB总线verilog代码实现（design篇）
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楼主: hbhbts

[原创] 关于AHB总线verilog代码实现（design篇）

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cqf6107848
发表于 2023-8-18 11:47:39 | 显示全部楼层
感谢分享
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公子无忌
发表于 2023-8-18 14:48:53 | 显示全部楼层
优秀！
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adi121293
发表于 2023-8-19 22:28:52 | 显示全部楼层
好好研究~~
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yuyu0907
发表于 2023-8-21 09:31:22 | 显示全部楼层
謝謝分享 非常好用
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damsonlin
发表于 2023-9-1 20:55:01 | 显示全部楼层
感謝分享喔
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冰若筱茗
发表于 2023-9-21 14:15:48 | 显示全部楼层
这个验证过没问题是吧？
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Qiuqq
发表于 2024-1-12 09:59:22 | 显示全部楼层
good~
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Ahungry_man
发表于 2024-1-16 09:59:30 | 显示全部楼层
谢谢！学习了
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夏尔
发表于 2024-1-26 14:15:36 | 显示全部楼层
:lol
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zzmmyy
发表于 2024-8-19 10:08:07 | 显示全部楼层
谢谢
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