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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 关于AHB总线verilog代码实现（design篇）
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楼主: hbhbts

[原创] 关于AHB总线verilog代码实现（design篇）

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durbin
发表于 2021-8-3 23:53:43 来自手机 | 显示全部楼层
good!
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乐行者独行
发表于 2021-8-13 10:03:45 | 显示全部楼层
感谢分享 谢谢
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lans0625
发表于 2021-8-14 13:07:48 | 显示全部楼层
thanks
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durbin
发表于 2021-8-27 11:25:41 | 显示全部楼层
great
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badegg3
发表于 2021-11-4 06:00:35 | 显示全部楼层
thanks for your sharing
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shikai_q
发表于 2021-11-4 18:20:57 | 显示全部楼层
学习了，谢谢
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cqf6107848
发表于 2022-3-23 15:33:30 | 显示全部楼层
感谢楼主分享
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yuminhunshi
发表于 2022-3-28 14:15:29 | 显示全部楼层
先赞再看，良好习惯
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许晴125
发表于 2022-4-14 14:35:15 | 显示全部楼层
强！！！！！！
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cqf6107848
发表于 2022-6-29 15:31:39 | 显示全部楼层
感谢楼主分享
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