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查看: 7991|回复: 24

[讨论] 请问ADPLL里滤波器如何设计?

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发表于 2013-11-22 01:06:15 | 显示全部楼层 |阅读模式

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把误差信号就是一串码字到滤波器之后应该怎么样设计这个滤波器才能得到所需的控制字?因为ADPLL有三个工作模式,得到的频率控制字怎么去加载?
以及如果相位差是个负数该怎么办?
谢谢!!!
望大侠告知!!!
发表于 2013-11-22 08:57:57 | 显示全部楼层
what is the type of the ADPLL ? Bangbang or TDC based ?
发表于 2013-11-22 09:58:27 | 显示全部楼层
这个我会,不过是机密,不能交流。
发表于 2013-11-22 11:42:28 | 显示全部楼层
这个应该没什么神秘的,滤波器分2部分,第一部分比例路径,相当于analog pll里面那个电阻,相位误差的数字表示乘以一个系数。另一个部分是累加,相当于原来的电容。
3个模式不是很明白。
相位差是负的也是一堆数字,还是按照上面的办法做。
当然最后还要映射到如何去控制vco上面去。
发表于 2013-11-22 20:35:35 | 显示全部楼层
回复 4# bananawolf


    三个模式指的是PVT,acquisition,tracking。模式依次转换就是gear shifting。最后不觉得负数会引起不能反馈。负数对应的是desired frequency 比free runnnig frequency小的情况= =
发表于 2013-11-23 15:17:20 | 显示全部楼层
回复 3# zhengyongzheng
发表于 2013-11-23 16:21:59 | 显示全部楼层
发表于 2013-11-24 06:37:35 | 显示全部楼层
回复 5# dhcchp


   莫非是陈总?
发表于 2013-11-27 22:16:27 | 显示全部楼层
回复 8# liuqilong8819


    这都知道!!!
 楼主| 发表于 2013-12-2 22:14:56 | 显示全部楼层
回复 2# wfcawy


   i am sorry the type is TDC
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