DC综合时钟过紧约束

上善若水8888 · 发表于 2013-3-26 20:20:04

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各位大神，请问DC综合时进行的时钟过紧约束，是过紧约束多少？是反应在时钟周期缩小？还是set_clock_uncertainty上？

my2817 · 发表于 2013-3-27 11:10:33

我的理解是clock period，比如说我chip实际要工作在１Ｍhz，那我在create_clock时给1GHz
GOOD LUCK!

上善若水8888 · 发表于 2013-3-27 16:26:27

回复 2# my2817

嗯，谢谢，与我理解的一样。

上善若水8888 · 发表于 2013-3-27 16:27:05

回复 2# my2817

嗯，谢谢，和我理解的一样。

zxyglx · 发表于 2020-4-8 17:43:42

[求助] DC综合时钟过紧约束