在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 5298|回复: 8

[求助] DC综合网表 quartus输入

[复制链接]
发表于 2013-2-28 23:18:07 | 显示全部楼层 |阅读模式
50资产
用DC综合,综合的库是读入的altera cycloneII的db文件现在得到综合后的网表,直接输入quartus,不能compilation,有些底层模块单元不能解析

请问应该加载哪些库文件和环境设置,以便quartus能正确读入网表?
谢谢

发表于 2013-2-28 23:43:08 | 显示全部楼层
没有必要这样做,如果你非要这样做,请去找10年前就停止更新了的DC FPGA版本。
 楼主| 发表于 2013-3-1 13:21:03 | 显示全部楼层
回复 2# Timme


   DC只是第三方EDA工具而已,altera是支持第三方EDA输入流程的。   我只是想知道,第三方综合工具用altera FPGA的库文件综合出的网表,quartus读入时应该怎样加入解析的lib,及相关的环境设置。
 楼主| 发表于 2013-3-2 23:20:33 | 显示全部楼层
有没有用第三方综合工具综合FPGA网表的,求教
发表于 2013-3-3 12:54:03 | 显示全部楼层
本帖最后由 504472832 于 2013-3-3 12:56 编辑

回复 4# supercainiao


   dc没综合过FPGA。。。
发表于 2013-3-3 12:54:57 | 显示全部楼层
本帖最后由 504472832 于 2013-3-3 12:56 编辑

回复 4# supercainiao


   还是试试 synplify or precision
 楼主| 发表于 2013-3-3 21:55:57 | 显示全部楼层
回复 6# 504472832


   synplify出来的是vqm,可以直接读入不用添加lib的,不过因为是ASIC转FPGA,只有DC的环境
发表于 2013-3-3 23:45:18 | 显示全部楼层




   DC的SDC约束小改一下就可以在Quartus上带时序综合了。Quartus对SDC的支持比其他任何FPGA软件都要好很多。
发表于 2013-3-8 21:25:05 | 显示全部楼层
DC是不能综合到FPGA器件上的,因为他的mapper不能将逻辑映射到FPGA的LUT上,而只能映射到标准单元库上。 So。。。。。。
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-22 15:42 , Processed in 0.029577 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表